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[发明专利]一种译码电路-CN201710487500.6在审
发明人：杨桂凤 -专利权人：杨桂凤
申请日： 2017-06-23 - 公布日： 2019-01-01 - 主分类号： H03M13/00 文献下载
摘要：本发明公开了一种译码电路，包括：第一非门、第一与非门、第二与非门、第三与非门和第四与非门；第一非门分别与第二与非门和第四与非门相连，第一与非门分别与第三与非门和第二与非门相连，第三与非门分别与第一与非门和第四与非门相连
与非门译码电路非门电子元器件电路结构

[实用新型]基于短脉冲单稳触发器的高频脉冲序列定时选通电路-CN202123028748.7有效
发明人：崔建国;宁永香;崔燚 -专利权人：山西工程技术学院;崔建国
申请日： 2021-12-06 - 公布日： 2022-07-05 - 主分类号： H03K5/13 文献下载
摘要：本实用新型公开了一种基于短脉冲单稳触发器的高频脉冲序列定时选通电路，与非门N1、与非门N2、与非门N3、与非门N5、与非门N7的输入端皆短接，中低频脉冲信号Ui1同时连接与非门N1的输入端以及与非门N4的13脚，与非门N1的输出连接与非门N2的输入，与非门N2的输出端连接与非门N3的输入端，与非门N3的输出端连接与非门N4的输入端12脚，与非门N4的输出端连接与非门N5的输入端，与非门N5的输出端连接与非门N6的输入端5脚，高频脉冲信号Ui2连接与非门N6的4脚，与非门N6的输出端6脚连接与非门N7的输入端，与非门N7的输出端即为输出脉冲信号
基于脉冲触发器高频序列定时通电

[发明专利]资料存储型闪存优化译码使能装置-CN201510406098.5有效
发明人：苏志强;丁冲;谢瑞杰;陈立刚 -专利权人：北京兆易创新科技股份有限公司
申请日： 2015-07-10 - 公布日： 2018-12-14 - 主分类号： G11C16/08 文献下载
摘要：本发明提出了一种资料存储型闪存优化译码使能装置，包括第一反相器，第二反相器、第三反相器、第一与非门、第二与非门、第三与非门、第四与非门和或非门；第一反相器输入端与比对电路连接，输出端与第一与非门第一输入端连接；第一与非门第二输入端接入控制使能信号；第二与非门、第三与非门及第四与非门输入端接入列地址，第二与非门输出端与第二反相器输入端连接；第三与非门输出端与第三反相器输入端连接；第四与非门输出端与或非门第一输入端连接，或非门第二输入端接入控制使能信号；第一与非门、第二反相器、第三反相器和或非门输出端与数据锁存器输入端连接。
资料存储闪存优化译码装置

[发明专利]一种高性能近似全加器门级单元-CN201910873564.9有效
发明人：刘伟强;哈伦·瓦里斯;袁田;王成华 -专利权人：南京航空航天大学
申请日： 2019-09-16 - 公布日： 2022-06-17 - 主分类号： G06F7/501 文献下载
摘要：本发明公开了一种高性能近似全加器门级单元，包括：第一或非门、第二或非门、第三或非门和非门；第一或非门的第一输入端为加数输入端，第二输入端为被加数输入端，输出端连接第二或非门的第一输入端和第三或非门的第一输入端；第二或非门的第二输入端为低位进位输入端，第二或非门的输出端为本门级单元的和输出端；第二或非门的第二输入端还与非门的输入端连接，而非门的输出端连接第三或非门的第二输入端，第三或非门的输出端为本门级单元的高位进位输出端
一种性能近似全加器单元

[实用新型]一种基于ONFI的DLL单元电路-CN201822277693.5有效
发明人：刘亚东 -专利权人：灿芯半导体（上海）有限公司
申请日： 2018-12-29 - 公布日： 2019-07-05 - 主分类号： H03L7/081 文献下载
摘要：本实用新型公开了一种基于ONFI的DLL单元电路，包括第一与非门、第二与非门、第三与非门、第四与非门、第五与非门、第六与非门、反相器和延迟单元DEL，所述第一与非门的A端接第一控制端，B端接第一延迟回路端，输出端接第二延迟回路端；所述第二与非门的A端接第一延迟回路端，B端接第二控制端，输出端接所述第三与非门的B端；所述第三与非门的输出端接第四延迟回路端，A端接所述第六与非门的输出端；所述第六与非门的A端接所述第四与非门的输出端，B端接所述第五与非门的输出端。
与非门输出端延迟回路本实用新型单元电路控制端传输频率延迟单元控制器反相器兼容应用

[发明专利]一种用于PWM型同步升压转换器的使能关断时序逻辑电路-CN201810680879.7在审
发明人：王东峰;刘桂芝;赵寿全;夏虎 -专利权人：无锡麟力科技有限公司
申请日： 2018-06-27 - 公布日： 2018-09-21 - 主分类号： H03K19/20 文献下载
摘要：本发明涉及同步升压转换器技术领域，尤其涉及一种用于PWM型同步升压转换器的使能关断时序逻辑电路，包括第一非门构成的反相单元，第一与非门和第二与非门构成的第一RS触发器，第三与非门和第二非门构成的第一逻辑单元，第三非门、第四非门、第一MOS管、第二MOS管、电阻和电容构成的逻辑延时单元，第五非门、第四与非门、第五与非门和第六非门构成的第二逻辑单元，第六与非门和第七非门构成的逻辑切换单元，第一或非门和第二或非门构成的第二
与非门非门同步升压转换器关断使能时序逻辑电路逻辑单元或非门逻辑切换单元电感储能固定延时过零检测逻辑延时输出信号信号引入有效释放功率管六非门电容电阻反相

[实用新型]一种用于PWM型同步升压转换器的使能关断时序逻辑电路-CN201821002829.5有效
发明人：王东峰;刘桂芝;赵寿全;夏虎 -专利权人：无锡麟力科技有限公司
申请日： 2018-06-27 - 公布日： 2018-12-21 - 主分类号： H03K19/20 文献下载
摘要：本实用新型涉及同步升压转换器技术领域，尤其涉及一种用于PWM型同步升压转换器的使能关断时序逻辑电路，包括第一非门构成的反相单元，第一与非门和第二与非门构成的第一RS触发器，第三与非门和第二非门构成的第一逻辑单元，第三非门、第四非门、第一MOS管、第二MOS管、电阻和电容构成的逻辑延时单元，第五非门、第四与非门、第五与非门和第六非门构成的第二逻辑单元，第六与非门和第七非门构成的逻辑切换单元，第一或非门和第二或非门构成的第二
与非门非门同步升压转换器关断使能时序逻辑电路本实用新型逻辑单元或非门逻辑切换单元电感储能固定延时过零检测逻辑延时输出信号信号引入有效释放功率管六非门电容电阻反相

[发明专利]一种数字控制的单稳态触发器及其控制方法-CN202010406822.5有效
发明人：王抗美 -专利权人：南京信息职业技术学院
申请日： 2020-05-14 - 公布日： 2023-07-25 - 主分类号： H03K3/033 文献下载
摘要：所述单稳态触发器包括作为输入端的与非门1、作为输出端的与非门2、电性连接于与非门1与与非门2之间的数字控制电路；所述数字控制电路包括分别与与非门1电性连接的与非门3和与非门4，所述与非门3通过RC电路与与非门1电性连接，所述与非门4通过计数器与与非门1电性连接；与非门3和与非门4分别电性连接有与非门5，与非门5与与非门2之间电性连接有JK触发器；计数器的时钟信号输入端电性连接有多谐振荡器。
一种数字控制稳态触发器及其控制方法

[实用新型]资料存储型闪存优化译码使能装置-CN201520500555.2有效
发明人：苏志强;丁冲;谢瑞杰;陈立刚 -专利权人：北京兆易创新科技股份有限公司
申请日： 2015-07-10 - 公布日： 2015-11-25 - 主分类号： G11C16/08 文献下载
摘要：本实用新型提出了一种资料存储型闪存优化译码使能装置，包括第一反相器，第二反相器、第三反相器、第一与非门、第二与非门、第三与非门、第四与非门和或非门；第一反相器输入端与比对电路连接，输出端与第一与非门第一输入端连接；第一与非门第二输入端接入控制使能信号；第二与非门、第三与非门及第四与非门输入端接入列地址，第二与非门输出端与第二反相器输入端连接；第三与非门输出端与第三反相器输入端连接；第四与非门输出端与或非门第一输入端连接，或非门第二输入端接入控制使能信号；第一与非门、第二反相器、第三反相器和或非门输出端与数据锁存器输入端连接。
资料存储闪存优化译码装置

[发明专利]一种非门控制继电器互锁电路-CN202011556226.1在审
发明人：刘文博;杨彩霞;张永生;廖艺真;张勇 -专利权人：通号万全信号设备有限公司
申请日： 2020-12-24 - 公布日： 2021-04-06 - 主分类号： H01H47/00 文献下载
摘要：本发明提供一种非门控制继电器互锁电路，包括第一执行继电器和第二执行继电器；第一非门电路、第二非门电路、第三非门电路和第四非门电路，其中，所述第一非门电路、第二非门电路与第一执行继电器相连，第三非门电路、第四非门电路与第二执行继电器相连，采用异构的硬件电路设计，实现执行继电器的相应动作，本发明中非门电路的器件均采用常规元器件，易于工程实现，本发明通过四路非门电路控制，实现继电器至多一路输出电源的功能。
一种非门控制继电器互锁电路

[发明专利]一种三输入通用逻辑门电路-CN201410417709.1在审
发明人：应时彦;肖林荣;张楠楠;陈杰 -专利权人：浙江工业大学
申请日： 2014-08-22 - 公布日： 2015-01-07 - 主分类号： H03K19/20 文献下载
摘要：一种三输入通用逻辑门电路，包括第一二输入与非门U1、第二二输入与非门U4、第三二输入与非门U5、第一非门U2和第二非门U3，各个门电路均由单电子晶体管组成；第一二输入与非门U1的第一输入端和第一非门U2的输入端相连，第一二输入与非门U1的输出端和第三二输入与非门U5的第一输入端相连；第一非门U2的输出端和第二二输入与非门U4的第一输入端相连；第二非门U3的输入端作为通用逻辑门电路的输入端V3，第二非门U3的输出端和第二二输入与非门U4的第二输入端相连；第二二输入与非门U4的输出端和第三二输入与非门U5的第二输入端相连。
一种输入通用逻辑门电路

[实用新型]一种三输入通用逻辑门电路-CN201420478957.2有效
发明人：应时彦;肖林荣;张楠楠;陈杰 -专利权人：浙江工业大学
申请日： 2014-08-22 - 公布日： 2014-12-24 - 主分类号： H03K19/20 文献下载
摘要：一种三输入通用逻辑门电路，包括第一二输入与非门U1、第二二输入与非门U4、第三二输入与非门U5、第一非门U2和第二非门U3，各个门电路均由单电子晶体管组成；第一二输入与非门U1的第一输入端和第一非门U2的输入端相连，第一二输入与非门U1的输出端和第三二输入与非门U5的第一输入端相连；第一非门U2的输出端和第二二输入与非门U4的第一输入端相连；第二非门U3的输入端作为通用逻辑门电路的输入端V3，第二非门U3的输出端和第二二输入与非门U4的第二输入端相连；第二二输入与非门U4的输出端和第三二输入与非门U5的第二输入端相连。
一种输入通用逻辑门电路

[发明专利]基于CMOS6非门的电场检测仪-CN200910100764.7无效
发明人：金隐华 -专利权人：浙江大学
申请日： 2009-07-21 - 公布日： 2009-12-16 - 主分类号： G01R29/12 文献下载
摘要：本发明公开了一种基于CMOS 6非门的电场检测仪，包括静电检测仪和音频电场检测仪。它们将CMOS 6非门集成电路的第一非门作电场检测，其余五个非门为中点电位稳定的反相放大器；第一非门输入端与探针连接。其中静电检测仪的第二非门用于前置放大，第三非门、第四非门并联作输出驱动，第五非门、第六非门并联及配上阻值相同的电阻构成增益为1的反相器；音频电场检测仪的第二非门、第三非门、第四非门构成增益无穷的反相放大器，配上第四电阻负反馈稳定直流工作点、同时与第二电容、第三电容一起构成带通放大器，第五非门、第六非门并联经隔直电解电容将音频电流输出至耳机供探测时诊听。
基于 cmos6 非门电场检测

[发明专利]一种用于BUCK-BOOST LED驱动电路的LED短路保护电路-CN201810636666.4在审
发明人：吴建良 -专利权人：无锡恒芯微科技有限公司
申请日： 2018-06-20 - 公布日： 2018-09-14 - 主分类号： H05B33/08 文献下载
摘要：本发明涉及LED驱动电路技术领域，尤其涉及一种用于BUCK‑BOOST LED驱动电路的LED短路保护电路，包括比较器、计时器、第一RS触发器、第一非门、第二非门、第三非门和第一与非门，计时器包括第一D触发器、第二D触发器、第三D触发器、第四D触发器、第五D触发器、第六D触发器、第二RS触发器、第一与门、第二与门、第三与门、第四与门、第二与非门、第三与非门、第四非门、第五非门、第六非门、第七非门、第八非门、第九非门、第十非门、第十一非门；本发明应用于BUCK‑BOOST LED驱动电路时，提高了系统稳定性，防止在LED短路情况下损坏芯片甚至炸机，且在LED短路情况下降低了系统输入功耗。
非门与门与非门短路保护电路计时器短路系统稳定性六D触发器系统输入比较器六非门功耗炸机芯片应用

[发明专利]高性能全加器运算单元电路-CN201210246287.7无效
发明人：吕虹;解建侠;赵彦强;严辉;张润梅;张曙光;王媛;夏义全;王坤侠 -专利权人：安徽建筑工业学院;吕虹
申请日： 2012-07-08 - 公布日： 2012-10-17 - 主分类号： H03K19/20 文献下载
摘要：本发明提供一种全加器运算单元电路，包括：第一级门电路，包括或非门1、或非门2、或非门3和或非门4；四个或非门的输入分别为(A、B)、(B、Cin)、(A、Cin)、(A、B、Cin)，其中，A、B、Cin为三个一位二进制输入信号，四个或非门的输出分别为Y11、Y12、Y13、Y14；第二级门电路，包括或非门5、或非门6、或非门7和或非门8；四个或非门的输入分别为(A、Y11、Y13)、(B、Y11、Y12)、(Cin、Y12、Y13)、(Y11、Y12、Y13)；四个或非门的输出分别为Y21、Y22、Y23、Cout；第三级门电路，包括或非门9；或非门9的输入为(Y21、Y22、Y23、Y14)，输出为
性能全加器运算单元电路

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